Memória Cache; Tecnologias para aumento de desempenho; Flashcards

1
Q

Memória mais rápida que RAM.

A

Memória cache.

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2
Q

Memória feita para acelerar processamentos repetidos.

A

Memória cache.

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3
Q

Esquema de atualização da cache onde o dado que é gravado na cache é imediatamente atualizado na RAM.

A

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4
Q

Esquema de atualização da cache onde o dado que é gravado na cache, porém a RAM pode ficar desatualizada.

A

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5
Q

Esquema de atualização da cache onde a RAM NUNCA fica DESATUALIZADA.

A

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6
Q

Esquema de atualização da cache onde a RAM é atualizada a todo momento.

A

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7
Q

Esquema de atualização da cache onde a RAM só é atualizada quando necessário.

A

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8
Q

Mapeamento onde a arquitetura é mais SIMPLES.

A

Mapeamento direto.

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9
Q

Mapeamento onde uma parte da cache aponta diretamente para outra parte da RAM.

A

Mapeamento direto.

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10
Q

Mapeamento onde a quantidade de cache MISS é alta.

A

Mapeamento direto.

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11
Q

Mapeamento onde cada parte da cache pode alcançar qualquer parte da RAM.

A

Mapeamento completamente associativo.

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12
Q

Mapeamento onde aumenta a quantidade de cache HIT.

A

Mapeamento completamente associativo.

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13
Q

Mapeamento onde mais complexo de ser implementado.

A

Mapeamento completamente associativo.

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14
Q

Mapeamento que cria grupos de cache para grupos de RAM.

A

Mapeamento associativo por grupos.

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15
Q

Mapeamento SIMPLES como o mapeamento direto.

A

Mapeamento associativo por grupos.

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16
Q

Mapeamento mais utilizado atualmente.

A

Mapeamento associativo por grupos.

17
Q

Tecnologia que tenta adivinhar o que o processador poderá executar.

A

Previsão de desvio.

18
Q

Tecnologia que se resume em carregar na
memória todos os desvios condicionais possíveis (se, case etc), e deixá-los prontos na memória para quando
forem requisitados.

A

Previsão de desvio.

19
Q

Quando o processador possui mais de uma unidade de busca. (mais de um pipeline)

A

Superescalar

20
Q

Conhecido como linha de produção.

A

Pipeline

21
Q

Quando as unidades internas do processador não ficam ociosas.

A

Pipeline.

22
Q

Quando o processador procura instruções que possam ser executadas antes mesmo que as anteriores.

A

Execução fora de ordem.

23
Q

Está uma passo além da previsão de desvio.

A

Execução especulativa.

24
Q

É uma melhoria da previsão de desvio.

A

Execução especulativa.

25
Q

É a troca da finalidade dos registradores ociosos para executar outra tarefa.

A

Renomeamento de registradores.

26
Q

Compreendem instruções CISC e RISC ao mesmo tempo.

A

Arquitetura híbrida CISC/RISC

27
Q

Une várias microinstruções do mesmo tipo e as executa de uma única vez.

A

Fusão de microinstruções.

28
Q

Une várias instruções do mesmo tipo e as executa de uma única vez.

A

Fusão de instruções.

29
Q

Tecnologia que consegue pegar núcleos de processadores ociosos e transforma em núcleos virtuais.

A

Hyper-threading

30
Q

Ato de forçar o processador a trabalhar com um clock além do especificado.

A

Overclock

31
Q

Ato de forçar o processador a trabalhar com um clock aquém do especificado.

A

Underclock

32
Q

Quando o processador possui a capacidade de aumentar o clock quando estiver sendo mais exigido e reduzir quando não estiver sendo exigido.

A

Overclock dinâmico.

33
Q

Canal de alta velocidade exclusivo da memória RAM com o processador.

A

Hyper-Transport.