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BLOQUE 2 FER > TEMA 1 INFORMATICA BASICA > Flashcards

TEMA 1 INFORMATICA BASICA Flashcards

(69 cards)

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1
Q

Relacion TPS, ETL, DWH (Data Warehouse), OLAP y Data Minin

A
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2
Q

CUANTOS BITS TIENEN UN CRUMB Y UN NIBBLE?

A

CRUMB= 2 BITS
NIBBLE= 4BITS

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3
Q

¿Qué es el código BCD y cómo funciona?

A

Dígito decimal Codificado en Binario. (8421)
Usa 4 bits para codificar cada dígito decimal individualmente.Ejemplo:

Decimal 5 → BCD: 0101

Decimal 23 → BCD: 0010 0011

Se usa en calculadoras, relojes digitales y sistemas donde es importante trabajar con dígitos decimales de forma precisa.

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4
Q

¿Qué es el código Aiken en sistemas digitales?

A

El código Aiken (también llamado BCD ponderado 2-4-2-1) es una variante del BCD que asigna pesos diferentes a cada bit para representar los dígitos del 0 al 9.

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5
Q

Cuales son los pesos en sistema internacional y en ISO/IE 80000-13??

A
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6
Q

¿Qué es Base64 y para qué se utiliza?

A

Base64 es un sistema de codificación que convierte datos binarios en texto ASCII usando 64 caracteres (letras, números y +, /).. el caracter “=” se usa par relleno o padding.
Ocupa un 33% mas.
Se usa para transmitir datos binarios (como imágenes o archivos) a través de sistemas que solo manejan texto, como emails o JSON.

Ejemplo de uso: adjuntar una imagen en un correo o en un campo de texto en una API.

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7
Q

¿Cuáles son los principales métodos de representación del signo en binario?

A

-Signo (bit) + módulo/valor absoluto del número. 0 = +; 1 = -.
-CA1: Complemento a 1. Doble representación del 0: 0000 y 1111. (de -7 a 7 y dobre representacion del cero)
-CA2: Complemento a 2. Es el CA1 + 1.(este no tiene doblre representacion del cero)

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8
Q

Que IEEE es la representacion de coma flotante??

A

IEEE 754

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9
Q

Dime los Metodos de Detencion de errores??

A

BIT DE PARIDAD, CRC, GRAY

BIT DE PARIDAD: Es un bit adicional que se añade a un conjunto de bits para detectar errores simples en la transmisión de datos.
Paridad par: el número total de unos (1) debe ser par
Paridad impar: el número total de unos debe ser impar
No corrige, solo detecta errores simples.
CRC (Cyclic Redundancy Check): CRC (Código de Redundancia Cíclica) es un método de detección de errores más avanzado que la paridad.
Código Gray: Es un código binario donde solo un bit cambia entre números consecutivos.

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10
Q

¿Cuáles son los métodos más comunes de detección y corrección de errores?

A

Código CRC (Codigo de Redundancia Ciclico)
Código de Hamming
Código Reed-Solomon
Código Reed- Muller
Golay
Viterbi Decoder

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11
Q

Cual es el codigo de la compresion de datos sin perdida??

A

HUFFMAN

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12
Q

Cual es la ISO de Conjunto de Caracteres Universal (UCS)??

A

ISO 10646

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13
Q

¿Cuáles son los principales sistemas de codificación de caracteres?

A
  • ASCII: 7 bits + 1 de paridad. 32-126: imprimibles. 0-31 y 127: no
    imprimibles. No tiene €, ni Ñ, ni letras con tilde, etc. A = 65.
  • EBCDIC: 8 bits. Mainframe de IBM. Cada país tenía su tabla. Cada tabla
    de caracteres se llama Codepage.
  • ISO 8859-1: Llamado Latin-1. 8 bits de verdad. Tiene Ñ, letras con tilde,
    etc, pero no tiene €. ISO-8859-15 incorpora €.
    En Windows hay una variante muy similar àWindows-1252 (aka ANSI)
  • UTF-8: 8 bit Unicode Transformation Format. Mínimo 8 bits. Longitud
    variable 1-4 bytes. Los de 1 byte coinciden con ASCII. Resto los más raros.
  • UTF-16: Mínimo 16 bits. Longitud variable de 2-4 bytes. 1 o 2 palabras
    de 16 bits. Cada palabra son 2 bytes.
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14
Q

Que arquitectura tiene una unica memoria para instrucciones y otra para datos?

A

ARQUITECTURA VON NEUMAN

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15
Q

Caracteristica de Arquitectura Harvard??

A

Memoria separada para instrucciones y datos. Mejor seguridad y rendimiento

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16
Q

¿Qué es una APU y qué integra?

A

Una APU (Accelerated Processing Unit) es un chip que integra CPU y GPU en un solo procesador. Cpu que viene con tarjeta grafica incluida.

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17
Q

Resumen del recorrido de la dirección o instrucción desde que sale del CP (contador de programa)

A

-El CP (contador de programa) contiene la dirección de la próxima instrucción a ejecutar.

-Esa dirección se envía al bus de direcciones y llega a la memoria (MEM).

-La memoria, usando esa dirección, localiza la instrucción correspondiente y la envía a través del bus de datos de vuelta a la CPU.

-La instrucción recibida se almacena en el registro de instrucción (RI) dentro de la CPU.

-Luego, la instrucción pasa al decodificador para ser interpretada y ejecutada por la CPU en el secuenciador

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18
Q

Cuals son los tipos de buses que nos encontramos en este proceso??

A
  • Control: operaciones de gestión/coordinación de otros elementos hardware. Ej. orden de lectura o escritura a la memoria RAM
  • Direcciones: direcciones de memoria RAM a acceder
  • Datos: instrucciones y/o datos que se leen y/o escriben
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19
Q

Que es el MAR (Memory Address Register)??

A

El MAR (Memory Address Register, o Registro de Direcciones de Memoria) es un registro de alta velocidad integrado en la CPU que almacena la dirección de memoria donde se va a leer o escribir un dato o instrucción. Esta entre el CP y el BUs de Direcciones.

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20
Q

Cual es el registro de la CPU que actúa como almacén temporal para los datos que se transfieren entre la memoria principal (RAM) y el procesador??

A

El MDR (Memory Data Register). o MBR (Memory Buffer Register) Y esta entre la Memoria y el CIR o IR (en el Bus de Datos)

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21
Q

Cual es el nombre específico del PC en arquitecturas x86 Intel??

A

El Instruction Pointer (IP)

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22
Q

¿Qué es el CIR o IR en un procesador?

A

El IR (Instruction Register) o CIR (Current Instruction Register) es el registro que almacena la instrucción actual que está siendo decodificada y ejecutada por la CPU. El IR (o CIR) es el registro donde la CPU almacena y decodifica la instrucción actual, siendo clave para la ejecución ordenada de los programas.

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23
Q

Que ponemos en el PC(Program Counter) en español el contador de programa??

A

IMPORTANTE. Tiene la DIRECCION DE MEMORIA DE LA SIGUIENTE INSTRUCCION A EJECUTAR.

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24
Q

¿Cuáles son las características principales de la arquitectura CISC?

A

*Muchas instrucciones complejas (pocas líneas de código)

*Ciclos de reloj largos por instrucción

*Usa instrucciones de alto nivel (como multiplicar, mover a memoria, etc.)

*Microprogramación en el hardware

*Orientado a reducir el número de instrucciones por programa

*Muy usado en x86 (Intel, AMD)

📌 Ventaja: menos código
📌 Desventaja: ejecución más lenta que RISC en algunas tareas

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25
¿Cuáles son las características principales de la arquitectura RISC?
*Pocas instrucciones simples y rápidas *1 ciclo de reloj por instrucción (en la mayoría) *Mayor uso de registros, menos acceso a memoria *Diseño eficiente y predecible *Facilita la pipelining *Usado en ARM, SPARC, MIPS, RISC-V 📌 Ventaja: alta velocidad y eficiencia 📌 Desventaja: necesita más instrucciones para tareas complejas
26
Con que parte tienen que ver el CISc y Risc??
El SECUENCIADOR
27
¿Cuáles son las principales medidas de rendimiento de una computadora?
*CPI (Ciclos Por Instrucción) *MIPS (Millones de Instrucciones Por Segundo) *FLOPS (Operaciones de Punto Flotante por Segundo) Velocidad de la CPU, medida en GHz. IPC (Instrucciones por Ciclo)
28
¿Cuáles son las categorías de la taxonomía de Flynn?
La taxonomía de Flynn clasifica arquitecturas según el número de instrucciones y datos procesados simultáneamente: SISD – Single Instruction, Single Data ➤ Un solo procesador, una sola instrucción, un solo dato. SIMD – Single Instruction, Multiple Data ➤ Una instrucción se aplica a varios datos (vectores). MISD – Multiple Instruction, Single Data ➤ Varias instrucciones sobre el mismo dato (raro o teórico). MIMD – Multiple Instruction, Multiple Data ➤ Varios procesadores ejecutan instrucciones distintas en datos distintos (como los multicore).
29
¿Qué es un Instruction Set en los enfoques de arquitectura de CPU?
* En CISC: instrucciones complejas que pueden tardar varios ciclos de reloj en ejecutarse. UC con Lógica programada. Ej. Familia x86 de Intel. * En RISC: instrucciones simples ejecutables en 1 ciclo de reloj. Pocos modos de direccionamiento. Instrucciones de tamaño fijo. UC con Lógica cableada. Ej. ARM
30
A que se refiere con esto, es un chip que integra en un solo circuito integrado todos los componentes esenciales de un sistema informático: CPU GPU Memoria (RAM/cache) Controladores de entrada/salida Módulos de red, audio, etc. 📱 Muy usado en móviles, tablets, smart TVs, IoT y consolas. 📌 Ventajas: Ahorro de espacio y energía Mayor eficiencia y menor coste de fabricación
Un SoC (System on Chip)
31
¿Cuáles son los SoC más conocidos y preguntables?
*Apple M1 / M2 / M3 Apple (serie A y M). *Qualcomm Snapdragon *MediaTek Dimensity / Helio *Samsung Exynos *HiSilicon Kirin (Huawei) *Rockchip *NVIDIA Tegra *Unisoc *Allwinner *Broadcom BCM (como el de Raspberry Pi)
32
¿Qué es el GRUB Bootloader y para qué sirve?
GRUB (GRand Unified Bootloader) es un gestor de arranque que: Permite seleccionar qué sistema operativo arrancar en computadoras con varios OS (multi-boot). Se carga al inicio del sistema desde el MBR o GPT. Carga el kernel del sistema operativo elegido. Soporta sistemas Linux, Windows, y otros. Puede configurarse para mostrar un menú con opciones de arranque.
33
¿Qué relación tiene el GRUB Bootloader con el MBR? Pero no el MBR que es igual q MDR.
El MBR (Master Boot Record) es el primer sector del disco donde se almacena el código de arranque. GRUB suele instalarse en el MBR para que, al encender el equipo, el BIOS ejecute GRUB primero. GRUB desde el MBR carga y muestra el menú de sistemas operativos disponibles. Luego GRUB carga el kernel del sistema operativo seleccionado. 📌 En sistemas modernos con UEFI, GRUB puede instalarse en la partición EFI en vez del MBR.
34
Siglas de los dos MBR estudiados?
MBR: Master Boot Record MBR: Memory Buffer Register (en otro contexto, aunque menos común) 📌 En la mayoría de los casos, MBR se refiere a Master Boot Record, que es el sector de arranque del disco.
35
¿En qué partes principales se divide el MBR (Master Boot Record)?
El MBR (512 bytes) se divide en tres partes principales: 1.Código de arranque (Bootloader): Ocupa los primeros ~446 bytes Programa que inicia el sistema operativo 2.Tabla de particiones: 64 bytes (4 entradas de 16 bytes cada una) Define hasta 4 particiones primarias o 3 primarias + 1 extendida 3.Firma de arranque (Boot signature): Últimos 2 bytes Valor fijo 0x55AA que indica que el MBR es válido y arrancable
36
¿Dónde se utiliza el MBR (Master Boot Record)?
En sistemas que usan el BIOS para arrancar (no UEFI). En discos duros tradicionales (HDD) y unidades SSD con particiones clásicas. Para gestionar el arranque y las particiones en discos de hasta 2 TB. En sistemas operativos antiguos y algunos actuales que mantienen compatibilidad con BIOS.
37
¿Qué son BIOS y UEFI y cuál es su función?
*BIOS (Basic Input/Output System): Firmware clásico que inicia el hardware y carga el sistema operativo en computadoras antiguas y algunas modernas. Usa MBR para el arranque. *UEFI (Unified Extensible Firmware Interface): Firmware moderno que reemplaza al BIOS, con más funciones, interfaz gráfica y soporte para discos grandes (GPT). Más rápido y seguro que BIOS. 📌 Ambos son responsables de iniciar el equipo y cargar el sistema operativo.
38
¿Por cual reemplazamos MBR en UEFI?
Por GPT (GUID Partition Table) permite: Soportar discos mucho más grandes (hasta varios exabytes). Tener hasta 128 particiones primarias sin particiones extendidas. Mayor seguridad con copias de respaldo de la tabla de particiones
39
¿Qué es el ciclo de fetch en la CPU?
El ciclo de fetch es la primera fase del ciclo de instrucción de la CPU. Consiste en obtener (buscar) la instrucción desde la memoria para que pueda ser ejecutada. 🔁 Pasos del ciclo de fetch: El Program Counter (PC) indica la dirección de la próxima instrucción. La instrucción se lee desde la memoria y se guarda en el Instruction Register (IR). El PC se incrementa para apuntar a la siguiente instrucción. 📌 Luego de fetch vienen los ciclos de decodificación y ejecución.
40
Quien es el chip del chipset que controla la comunicación entre la CPU, la memoria RAM y la tarjeta gráfica. También manejo el acceso rápido a estos componentes críticos para el rendimiento del sistema.
Chipset Northbridge
41
Que es el Chipset Southbridge?
El chip del chipset que se encarga de controlar los dispositivos de entrada/salida más lentos, como puertos USB, discos duros SATA, audio, red y el BIOS.
42
Que es FSB (Front Side Bus)???
El bus principal que conecta la CPU con el chipset (Northbridge), permitiendo la comunicación con la memoria RAM y otros componentes. De mi velocidad depende el rendimiento general del sistema en arquitecturas más antiguas.
43
¿Por quien se sustituyó el FSB (Front Side Bus)?
Intel: DMI o QPI (QuickPath Interconnect) y ahora también UPI (Ultra Path Interconnect) AMD: HyperTransport
44
¿Cuáles son las jerarquías de memoria en base a su velocidad, de mayor a menor?
🔼 De más rápida a más lenta: 1.Registros (dentro de la CPU) 2.Caché L1 3.Caché L2 4.Caché L3 5.Memoria principal (RAM) 6.Memoria virtual (parte del disco duro usada como RAM) 7.Almacenamiento secundario (SSD, HDD) 🧠 A medida que la memoria es más rápida, también es más costosa y de menor capacidad.
45
¿Cuáles son los niveles de memoria caché y sus características principales?
Caché L1: → Más rápida y pequeña (16-64 KB), integrada en la CPU. Caché L2: → Más grande (256 KB - 1 MB), un poco más lenta, puede estar en CPU o cerca. Caché L3: → Más grande (2-32 MB), compartida entre núcleos, más lenta que L2.
46
Cual de los tipos de memoria cache tiene un nivel para datos y otro para instrucciones recordando ya a una arquitectura HARVARD??
LAS memorias cache DE NIVEL 1(L1), TIENEN UNA DE NIVEL 1 PARA DATOS Y OTRA DE NIVEL 1 PARA INSTRUCCIONES
47
¿Qué es la memoria ROM?
Memoria de solo lectura que contiene datos e instrucciones permanentes, no volátil, usada para almacenar firmware y el BIOS.
48
¿Cuáles son los tipos más comunes de memoria ROM?
PROM: Programable una sola vez. EPROM: Borrable con luz ultravioleta y reprogramable. EEPROM: Borrable eléctricamente y reprogramable en circuito. Flash ROM: Variante de EEPROM, más rápida y usada en almacenamiento masivo.
49
¿Para qué se utiliza la memoria ROM en un ordenador?
Para almacenar el firmware básico, como el BIOS o UEFI, que inicia el hardware y carga el sistema operativo.
50
¿La memoria ROM es volátil o no volátil?
Es no volátil, conserva la información aunque se apague el equipo.
51
¿Qué es la memoria RAM?
Memoria de acceso aleatorio, volátil, usada para almacenar datos e instrucciones que la CPU necesita rápidamente durante la ejecución.
52
¿En qué se diferencia la SRAM de la DRAM?
SRAM: Memoria rápida, no necesita refresco, usada en caché. MEMORIA CACHE DRAM: Más lenta, necesita refresco constante, usada como memoria principal.
53
¿Qué es la SDRAM?
SINCRONA NO ESTATICA!!! IMP. ES: DDR-DINAMICA-VOLATIL-SINCRONA Memoria DRAM sincronizada (SINCRONA)con el reloj del sistema para mejorar velocidad y eficiencia.
54
¿Qué significa DDR en DDR SDRAM?
Double Data Rate: transfiere datos dos veces por ciclo de reloj, duplicando la velocidad. Es capaz de transferir datos tanto en ciclos de reloj de subida como de bajada.
55
¿Qué es la NVRAM?
RAM no volátil. Alimentada por una batería.
56
¿Para qué se usa un módulo SO-DIMM?
Módulo de memoria pequeño para laptops y dispositivos compactos. Para ORDENADORES PORTATILES.
57
¿Qué es la memoria GDDR?
Memoria gráfica diseñada para tarjetas de video, optimizada para alto ancho de banda. Memoria para la tarjeta gráfica.
58
¿En qué destaca la LPDDR?
Memoria RAM de bajo consumo energético para dispositivos móviles.
59
¿Qué significa CAS Latency (CL) en memoria RAM?
Es el número de ciclos que tarda la RAM en comenzar a entregar datos después de recibir una solicitud. SERIA CUANTO DE RAPIDO ME RESPONDE MI MEMORIA; CUANTO MENOR TIEMPO DE CL MEJOR ES LA MEMORIA
60
QUE ES RAS?
tiempo que tarda la memoria en colocarse sobre una fila.
61
QUE ES CAS??
tiempo que tarda la memoria en colocarse sobre una columna o celda.
62
QUE ES ACTIVE??
indica el tiempo que tarda la memoria en activar un tablero.
63
QUE ES PRECHARGE??
indica el tiempo que tarda la memoria en desactivar un tablero.
64
Cual es el tiempo que tarda la memoria en proporcionar el dato??
ACTIVE + RAS + CAS.
65
Cual es el organismo estándar internacional que define especificaciones y estándares para la industria de semiconductores, incluyendo memorias RAM y otros dispositivos electrónicos.
JEDEC es el organismo estándar internacional
66
¿Qué es la memoria caché?
Es una memoria pequeña, rápida y cercana a la CPU que almacena temporalmente datos e instrucciones usados con frecuencia para acelerar el acceso y mejorar el rendimiento. SRAM
67
Como trabaja la memoria cache?
La cache trabaja a nivel de bloque no de celda
68
¿Qué son las políticas de actualización en memoria caché?
Política de actualización: Decide cuándo y cómo se actualizan los datos en la caché y memoria principal. -Write-through: Escribe datos simultáneamente en caché y memoria principal. -Write-back: Escribe datos solo en caché y actualiza la memoria principal después.
69
¿Qué son las políticas de ubicación en memoria caché?
-Direct mapping (directa): Cada bloque de memoria principal tiene una única posición en caché. Operacion MOD -Fully associative(asociativa): Cualquier bloque puede almacenarse en cualquier posición.se va guardando en los marcos de la caché, para localizar el bloque hay que recorrer toda la cache hasta encontrarlo -Set associative(asociativa por conjuntos): Combina ambos, con conjuntos de posiciones posibles. MIx de las anteriores

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